【摘 要】
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本文提出了一种利用综合引擎重现算术电路的优化过程的算法,提高了等价性验证效率.ZDFV的综合引擎首先识别乘法器的编码方式,提取部分积的加法树实现方案;然后根据这些信息生成与实现电路结构相似且逻辑正确的网表.本算法可直接结合到现有的RTL和门级网表的验证流程中,从而提高算术电路的验证能力.
【机 构】
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浙江大学超大规模集成电路设计研究所,浙江,杭州,310027
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本文提出了一种利用综合引擎重现算术电路的优化过程的算法,提高了等价性验证效率.ZDFV的综合引擎首先识别乘法器的编码方式,提取部分积的加法树实现方案;然后根据这些信息生成与实现电路结构相似且逻辑正确的网表.本算法可直接结合到现有的RTL和门级网表的验证流程中,从而提高算术电路的验证能力.
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