【摘 要】
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Design of electrical interconnects using full-wave electromagnetic solvers is necessary due to increased operating speed,miniaturization and 3D integration.Thus,segmented study and optimization are be
【机 构】
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Analog Devices Inc.
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Design of electrical interconnects using full-wave electromagnetic solvers is necessary due to increased operating speed,miniaturization and 3D integration.Thus,segmented study and optimization are becoming essential for maintaining link signal integrity.This paper addresses Pre&Post layout methods used for high speed SERDES PCB layout design to speed up design flow.The methodology was investigated in one of PHY evaluation boards.Measured results showed that channel performance could achieve the desired goals.And this paper gives a vivid example about the specific steps about the pre&post layout simulation.These methodologies could be treated as handy reference and general guidelines applied to different high speed SEREDS lane resulting in a significant improvement of overall channel signal integrity performance.
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