【摘 要】
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以集成老化仪的模拟部分设计为背景,采用ARM作为系统的主控制器,FPGA作为模拟部分的协处理器,AD7367作为模数转换器,设计了集成老化仪模拟部分的数据回检系统.相比于传统的数
【机 构】
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杭州电子科技大学通信工程学院,浙江杭州310018
【出 处】
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杭州电子科技大学第八届研究生IT创新学术论坛
论文部分内容阅读
以集成老化仪的模拟部分设计为背景,采用ARM作为系统的主控制器,FPGA作为模拟部分的协处理器,AD7367作为模数转换器,设计了集成老化仪模拟部分的数据回检系统.相比于传统的数据存储及异步数据传输方法,在不使用FIFO或RAM等存储器及不对待传输数据添加冗余信息的基础上,提出了一种大量节省软、硬件开销的数据回传方案.系统软件设计主要是对FPGA的Verilog编程，包括识别ARM发来的控制信息、对AD7367的工作进行控制、处理AD的串行输出数据以及将数据通过SPI回传给ARM。其中，重点是协调ARM与FPGA的异步通信以实现数据不重复、无遗漏的传输。最后通过Signal Tap仿真,并给出仿真结果.结果表明此设计在节省软硬件的基础上可准确无误的恢复出老化信号.
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