【摘 要】
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2010年以来存储行业的竞争激烈程度不断加剧,对于内存产品来说更是如此,内存芯片生产厂商为了维持产品的竞争力保持着1～1.5年推出一套新生产工艺的演进速度。然而,在工艺技术不断提高且生产控制能力不断增强的趋势下,仍无法精确控制所有内存产品的时序特性。因此,在实际应用中无论引入同一品牌不同生产工艺的内存器件还是不同品牌的内存器件时,必须要考虑应用端时序配置与内存时序特性之间的匹配问题。当前主流解决时
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2010年以来存储行业的竞争激烈程度不断加剧,对于内存产品来说更是如此,内存芯片生产厂商为了维持产品的竞争力保持着1～1.5年推出一套新生产工艺的演进速度。然而,在工艺技术不断提高且生产控制能力不断增强的趋势下,仍无法精确控制所有内存产品的时序特性。因此,在实际应用中无论引入同一品牌不同生产工艺的内存器件还是不同品牌的内存器件时,必须要考虑应用端时序配置与内存时序特性之间的匹配问题。当前主流解决时序匹配问题的方法包括时序校准以及硬件调整时序等,但这两种方法都存在用时长、复杂程度高、灵活度差等问题,对于成本和时效敏感的项目来说,这些缺点无疑是产品高效量产的障碍。采取有效的方式使应用能够高效地适配不同时序特性的内存器件,并能够有效地验证适配结果具有应用价值和现实意义。本文以目前广泛使用的DDR3（Double Data Rate 3rd Generation SDRAM,DDR3 SDRAM,简称DDR3）内存器件作为研究对象,在现有校准机制的基础上围绕如何使平台高效地适配具有不同时序特性的DDR3器件这一问题展开研究。文中详细研究了DDR3器件的结构及功能操作,并分析了应用端主流在使用的DDR3校准方法及原理,发现这些校准机制并不能在应用中高效地适配具有不同时序特性的DDR3器件。针对这个问题本文在DDR3操作规范的基础上,找到应用中因DDR3器件之间时序特性差异而导致时序违规的根源,提出了针对DDR3器件时序差异的自适应适配方法;即通过找到各关键信号之间的时序适配边界,使用软件手段实现对关键信号的时序调整,并使用不同时序配置的软件版本与具有不同时序特性的DDR3器件自适应适配。在设计方案及验证方法上,本文使用Xilinx公司的开发平台Vivado及Kintex7系列开发板,通过实现本文提出的时序调整及配置方法,对具有时序特性差异的DDR3器件进行实际的匹配验证,验证结果证明本文提出方法的有效性及高效性。
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