【摘 要】
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为提升现场可编程门阵列(Field Programmable Gate Array, FPGA)的性能,异构技术开始被采用。这就要求电子辅助设计工具必须提供相应的功能来支持异构FPGA的开发。本文主要研
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为提升现场可编程门阵列(Field Programmable Gate Array, FPGA)的性能,异构技术开始被采用。这就要求电子辅助设计工具必须提供相应的功能来支持异构FPGA的开发。本文主要研究异构FPGA的技术映射问题并提出了一种解决方案。首先,在设计过程中,利用辅助设计工具来支持模块化的开发,把设计中的部分模块直接映射到FPGA中的硬核电路；其次在寄存器转移级综合阶段,通过电子设计自动化工具识别出可由FPGA内部小规模硬核电路实现的模块,并实现相应的映射；接着在传统的技术映射阶段,设计不同输入规格的查找表用于优化最终电路；最后在布尔匹配过程中,使用SAT(Satisfiability)技术来解决含有宏门的可编程逻辑模块的功能匹配问题。实验表明,采用异构的查找表来映射电路可以减小关键路径上的时间延迟；通过把可编程逻辑单元的输入划分为等价类,能够有效加快布尔匹配的速度。
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