【摘 要】
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在现代通信中,常常使用纠错编码技术来提高系统性能,其中卷积码由于其出色的纠错性能而得到了广泛使用。Viterbi译码算法是卷积码的一种概率译码算法,其本质就是最大似然译码
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在现代通信中,常常使用纠错编码技术来提高系统性能,其中卷积码由于其出色的纠错性能而得到了广泛使用。Viterbi译码算法是卷积码的一种概率译码算法,其本质就是最大似然译码。在实际应用中,如何根据要求有效实现Viterbi译码器是很重要的。文中首先介绍了卷积码以及Viterbi译码算法的基本原理,然后对Viterbi译码器的各个模块的FPGA实现进行了详细介绍,并重点阐述了译码器的两个关键单元:加比选单元和路径度量存储单元,比较了目前业内的几种主要的实现方法,最后该译码器通过ModelSim进行仿真,并在Xilinx的FPGA平台上实现。
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