【摘 要】
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低密度校验(LDPC)码被证明是一类纠错性能逼近Shannon限的好码。多元LDPC码与二元LDPC码相比性能更好,然而,这是以高译码复杂度为代价的。本文作者结合国家863计划项目(2006A
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低密度校验(LDPC)码被证明是一类纠错性能逼近Shannon限的好码。多元LDPC码与二元LDPC码相比性能更好,然而,这是以高译码复杂度为代价的。本文作者结合国家863计划项目(2006AA01Z267),对多元LDPC码译码器的设计与实现问题进行了研究。主要完成的工作有以下几个方面。分析了基于有限域的多元LDPC码的译码算法,通过分析发现,多元LDPC码的译码复杂度主要集中在校验节点更新的计算。扩展最小和(EMS)算法能够降低校验节点更新的计算复杂度。结合仿真,对EMS算法的性能和复杂度做了进一步研究,并对EMS算法的特点进行深入分析。通过对EMS算法特点的分析,对一个GF(64)上码长1044bits、码率1/2的多元LDPC码,采用Xilinx Virtex-4系列XC4VLX60 FPGA芯片设计并完成译码器,对该译码器中各模块的结构和功能做了详细说明,并对译码器功能做了验证仿真。
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