【摘 要】
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随着智能化和信息化时代的到来,集成电路产业以及5G信息技术迎来了颠覆性地发展,此时5G通信芯片的后端设计就显得愈发重要,随着研究的不断深入,人们发现LDPC码也能逼近香农极限,本论文在28nm工艺下成功设计出5G信道LDPC码编码器的数字后端版图,主要工作如下:（1）使用Design Compiler工具完成28nm工艺下的5G信道编码器的综合工作,综合过程中严格根据手册设置input/outpu
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随着智能化和信息化时代的到来,集成电路产业以及5G信息技术迎来了颠覆性地发展,此时5G通信芯片的后端设计就显得愈发重要,随着研究的不断深入,人们发现LDPC码也能逼近香农极限,本论文在28nm工艺下成功设计出5G信道LDPC码编码器的数字后端版图,主要工作如下:（1）使用Design Compiler工具完成28nm工艺下的5G信道编码器的综合工作,综合过程中严格根据手册设置input/output delay并迭代尝试最佳SDC端口约束;（2）使用Innovus工具和综合得到的网表以及28nm工艺下的库文件完成5G信道编码器的布局布线工作,并得出版图雏形;（3）使用Starrc在28nm工艺下得到Spef文件并和Prime Time工具结合使用生成SDF时序文件从而对本设计进行静态时序分析,最终配合Innovus工具完成本设计的时序收敛和功耗分析;（4）在5G信道编码器的数字后端设计的最终阶段使用Calibre工具完成物理验证、使用Formality工具完成形式验证、使用Prime Time完成时序验证并且满足28nm下的Sign Off文档的标准。本文针对5G信道编码器的IP级数字后端设计在28nm工艺下的设计可行性问题进行研究,在满足签核标准下充分验证了该工艺下5G信道编码器ASIC芯片IP级后端设计的可行性,并满足时序收敛、可制造性等预期效果。
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