【摘 要】
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为得到一系列的不同频率的信号,对输入标准的参考频率源进行算术运算,这种技术被称为频率合成技术。频率合成器在近现代电子系统和装备当中的应用极为广泛,在航空、信息交换
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为得到一系列的不同频率的信号,对输入标准的参考频率源进行算术运算,这种技术被称为频率合成技术。频率合成器在近现代电子系统和装备当中的应用极为广泛,在航空、信息交换、仪器仪表、信息对抗等领域都能见到频率合成器的身影。频率合成理论提出的比较早,20世纪30年代就有人涉猎该领域的研究,在人们不断努力下,该项技术有了很大的发展。如今,人们想要实现频率合成已经有四个方法可以选取,即直接模拟频率合成技术(DAS)、锁相环频率合成技术、直接数字频率合成技术、以及DDS和锁相环结合的混合式频率合成技术。本文设计了一个基于FPGA的DDS+PLL频率合成器。DDS+PLL频率合成的优势就在于,这两项技术的结合使彼此的优点相得益彰,同时,是彼此的缺点得到很大的弥补。DDS弥补了PLL分辨率较低的劣势,PLL弥补了DDS输出频率不够高的缺陷。本文设计的DDS激励PLL的频率合成器,选用的是CycloneⅢ系列器件,输入频率设定为50MHz,相位累加器位数设定为10,得到合成器能达到如下指标：分辨率48.828KHz；输出频率范围为5.127MHz～1298.115MHz
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