【摘 要】
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该论文讨论了3.125G SERDES的部分重要内容.最关键的是频率合成器和时钟恢复电路的设计.频率合成器是传统的电荷泵锁相环,采用了单端环形振荡吕.为了防止时钟恢复电路误锁在N
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该论文讨论了3.125G SERDES的部分重要内容.最关键的是频率合成器和时钟恢复电路的设计.频率合成器是传统的电荷泵锁相环,采用了单端环形振荡吕.为了防止时钟恢复电路误锁在NRZ数据的奇次谐波和次谐波上,采用了主从双环路结构和鉴频鉴相双环路.由于Hogge Detector作为鉴相器会引入数据相关抖动,因而采用边沿有效的鉴相器.针对锁相环的捕获范围总是小于保持范围的特性,改进了鉴频器,使鉴频器在锁定和失锁的状态具有不同的阈值.器件固有的热噪声会限制单端环形振荡器的性能,该文采用时变的噪声模型一分析热噪声引起的时钟抖动,还考虑了噪声级间放大引起的噪声.通过SPICE瞬态分析模拟了热噪声引起的时钟抖动,并比较了模拟结果和理论分析结果.理论分析和模拟都表明单端环形振荡器输出时钟抖动的方差反比于功耗,而和振荡器的级数、信号压摆率、MOS管沟道长度等没有关系.尽管时钟抖动随频率升高而减小,但是时钟抖动和周期的百分比随频率升高而增大,因而热噪声引起的抖动随频率升高成为更加重要的问题.最后介绍了两种输入输出电路.一个是PECL输出电路,另一个是HSTL输入电路.给出的PECL输出电路设计和实验结果,在性能上优于或相当于最近发表的两篇文献.HSTL输入电路是一个具有死区的比较器.它的功耗和面积都很小.
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