【摘 要】
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该文在课题组已有工作基础上,完善、发展了数字电视传输流生成、分析、检错、输出、截取系统.首先,采用最新商品化的高速器件,设计、实现了单FIFO缓存器、占用PCI 16位数据的
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该文在课题组已有工作基础上,完善、发展了数字电视传输流生成、分析、检错、输出、截取系统.首先,采用最新商品化的高速器件,设计、实现了单FIFO缓存器、占用PCI 16位数据的方案.设计并实现了两片先入先出(FIFO)存储器读(输出)写(截取)时钟的错开,即分别取八分之一串行码率时钟的奇、 偶节拍,便捷地完成了PCI总线16位数据与机顶盒8位数据的转换.所采用的PCI 16位数据线方案是一种折衷考虑一方面与8位数据相比,提高了效率,在相同数据传输速率下,有利于降低时钟频率;另一方面,若用32位数据方案,则需4片外部FIFO,会增加电路的复杂度.继而,该论文设计、实现了TS输出与截取功能及电路的整合.利用PCI总线接口芯片S5933的双向性,令其内部的两套FIFO,分别完成由PCI到ADD_ON和ADD_ON到PCI的数据传递,并成功地把输出与截取电路中的外FIFO读、写控制电路归一化,得以用一套外FIFO及其外围控制电路,完成输出和截取两种功能,码流速率为3Mbps~30Mbps.系统基于通用微机构筑,由一块PCI总线插卡,经改接跳线,可分别完成码流输出或截取两种功能,实用而可靠.
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