基于频谱模块ASIC芯片设计的频谱处理实现

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随着现代社会无线通信技术的飞速发展,电磁频谱资源如何高效的进行数字模块监测和处理越发重要,无论在军用还是民用领域频谱资源监测和处理都是不可或缺。专用模块的频谱处理实现方式而言,无论采用计算机、通用频谱芯片、FPGA内嵌算法模块都会存在功耗、速度、精度、资源利用率等问题。为了实现智能网络集成系统的实时性、小型化的研发要求,本文基于频谱感知平台,提出一种频谱处理模块的ASIC芯片解决方案。本文设计并实现数字信号的频谱处理芯片化设计,达到在复杂的电磁环境中高效的进行频谱处理的效果。本文探讨了频谱处理模块的ASIC芯片化实现,首先以快速傅里叶变换(Fast Fourier Transform,FFT)算法为基础,进行频谱处理算法及结构的研究。基于性能最优进行算法模块的选择。然后确定频谱处理模块芯片化总体的电路结构,并进行了FPGA层面的功能验证,最后完成了频谱处理模块的芯片化物理后端设计。本文提出了一种频谱处理ASIC芯片结构并实现了频谱处理功能。为了实现频谱数据处理对吞吐量、点数、精度的要求,设计频谱处理模块ASIC芯片。设计改进高性能的快速傅里叶变换处理模块,采用跨时域抽取的Radix-2,4096点算法,流水线结构为芯片的主体算法。为了降低频谱泄露带来的危害,添加加窗模块对输入数据进行优化处理,设计实现输入控制模块和输出控制模块完成对数据流的转换及控制。并且通过CGU模块对整个时钟复位进行管理,添加DFT模块确保芯片设计的成功率,最终实现频谱处理模块ASIC芯片化项目研发。为了验证本文所设计的频谱处理模块,基于AD9361-ZYNQ7035频谱感知硬件开发平台进行了 RTL功能验证。通过vivado资源对比发现,资源利用较低,本次设计兼顾资源利用情况。完成频谱处理模块的功能验证后,本文基于SMIC 0.18μm工艺完成了频谱处理模块的逻辑综合、版图设计、时序分析等ASIC设计流程,并实现了芯片的LQFP100封装版图设计,版图尺寸大小为4.1mmx4.1mm。实现频谱模块ASIC芯片设计的频谱处理,其输入数据在61.44MHz时钟的连续输入下,完成一次完整的4096点扫频需要0.368ms,平均每0.368ms传输8192字节数据数量,即22MB/s。运算结果由输出控制模块传输至ARMSoC芯片,在上位机进行显示,实现时域信号到频域信号的数据处理效果。本文完成了频谱处理模块的ASIC整体设计及物理实现,符合项目小型化、高速的设计要求。
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