高性能锁相环IP设计

来源 :中国科学院微电子中心 中国科学院微电子研究所 | 被引量 : 0次 | 上传用户:waterhunter
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锁相环在遥感、通讯、控制等领域受到了广泛地应用.特别是随着SOC时代的到来,它成了单片系统中一个必不可缺的重要部件,人们用它来给系统提供时钟信号并且消除内部时钟和外部时钟之间的偏移.因此研究高性能锁相环IP有着重要的意义.该文首先从锁相环的基本原理出发,阐述了环路中各个组成部分的不同结构,并对它们的性能和实现方法一一做了比较.在这基础上研究了锁相环路的主要性能指标以及影响因子,最后综合考虑整个环路的特性要求设计了一款最高输出频率大于500MHz,锁定时间小于lms,相抖小于200ppm的高性能锁相环,电路实现工艺为TSMC 0.25um CMOS工艺.
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