CMOS数模混合锁相环设计及应用

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该文的研究目标是利用0.6μmDPDMCMOS 工艺设计一种高性能的数模混合锁相环核.研究内容包括锁相系统的模型建立与系统仿真、锁相系统中的各个模块设计,包括鉴相器、电荷泵、环路滤波器、钳位运算放大器、压控振荡器、分频器、带隙电路、晶体振荡电路等.在所设计的电路基础上进行版图设计,完成DRC、LVS以及LPE后进行后仿真,最后在无锡华晶上华半导体公司流片并测试.
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