【摘 要】
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该课题的目的是设计出应用于网络智能仪表中的显示板及CPLD (ComplexProgrammableLogicDevice )显示控制芯片.在设计过程中,作者采用了VHDL(VeryHighSpeedIntegratedCircuitH
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该课题的目的是设计出应用于网络智能仪表中的显示板及CPLD (ComplexProgrammableLogicDevice )显示控制芯片.在设计过程中,作者采用了VHDL(VeryHighSpeedIntegratedCircuitHardwareDescriptionLanguage)语言实现显示控制芯片的设计.为了保证设计的快速性,正确性,提高芯片的利用率,采用了TOP—DOWN层次化的设计方法.首先是从系统级开始入手,把系统分成四个基本单元模块,进而再把作为基本单元的这些模块分成下一层的子模块,直至可以用元件库中的元件实现为止.这个过程可以理解为从硬件的高层次抽象描述向最低层结构描述的一系列转换过程,直到最后得到可实现的硬件单元.在TOP—DOWN的设计过程中,划分每一个层次模块时要对目标模块做优化,并在实现模块时要进行模拟仿真.经过作者认真的编写和调试,以上两个任务都已圆满实现.在这个过程中,对可编程逻辑器件的结构,性能及VHDL语言的编程方法都有了进一步的了解.并且在实际设计中,设计人员应该根据对象的特点,在不同的层次上对设计对象进行描述,灵活的使用VHDL程序,原理图或有限状态机等各种编程方法.
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