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本论文研究并设计了一个可用于信息安全系统数据加解密的芯片。该芯片采用高级数据加密标准(AES)的分组密码算法。
文中首先阐述了AES算法的数学知识；接着详细描述了算法流程，包括：加密算法流程、密钥生成方案、直接解密算法流程、等价解密算法流程；然后，研究了AES芯片的硬件设计，包括：芯片的总体结构、轮结构中各个变换的设计和轮密钥生成模块的设计。 由于AES分组密码算法的加密和解密是不对称的，所以在硬件的设计过程中，尽量复用运算功能相同的单元，减小了芯片的面积；关掉处于空闲状态模块的时钟，降低了功耗；提前计算轮密钥，并采用流水线结构，既降低了控制模块的复杂性又提高了芯片的吞吐量。