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使用VHDL语言来设计数字频率计，给出了原理图和仿真图形，所设计的电路通过硬件仿真，下载到目标器件上运行，能够满足测量频率的要求，具有理论与实践意义，实现了电子电路自动化（EDA）的过程。
基于VHDL的数字频率计的设计
【摘 要】
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使用VHDL语言来设计数字频率计，给出了原理图和仿真图形，所设计的电路通过硬件仿真，下载到目标器件上运行，能够满足测量频率的要求，具有理论与实践意义，实现了电子电路自动化（EDA）的
【机 构】
：
长江大学电子信息学院
【出 处】
：
长江大学学报(自然科学版)理工卷
【发表日期】
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2008年1期
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