【摘 要】
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分数延迟FIR滤波器有能改变频率响应特性的优点,但是分数延迟FIR滤波器对系数变化十分敏感且其系数无对称关系,所以实现分数延迟FIR滤波器相对实现FIR滤波器消耗的硬件资源多
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分数延迟FIR滤波器有能改变频率响应特性的优点,但是分数延迟FIR滤波器对系数变化十分敏感且其系数无对称关系,所以实现分数延迟FIR滤波器相对实现FIR滤波器消耗的硬件资源多得多。FPGA有丰富的内部逻辑资源,完全能满足分数延迟FIR滤波器设计的需要。本文提出基于分布式算法和CSD码量化设计分数延迟FIR滤波器。基于分布式算法设计分数延迟FIR滤波器是将乘法运算转换为查找表操作并结合流水线技术节省硬件资源,提升处理速度;CSD码量化滤波器系数使其表示码中0最多,这样设计实现滤波器的硬件规模会大大减少,运算
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