实现3—2译码及2—3编码的射极耦合逻辑电路

来源 :杭州大学学报(自然科学版) | 被引量 : 0次 | 上传用户:fencer_200
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本文运用作者最近提出的适用于射极耦合逻辑电路(ECL)设计的代数系统进行了3—2译码器及2—3编码器的ECL电路设计.它们不仅结构简单,而且适用于做成全译码电路及通用编码电路.
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