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文中介绍了由VFC芯片鉴频，鉴相器(PFD)组成的数字锁相环路(DPL)抑制噪声的原理和有关参数的选择和计算；讨论了由DPLL和微处理机结合组成的数据采集系统，信噪比改善的可能性。
高信噪比的VFC／DPLL数据采集装置
【摘 要】
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文中介绍了由VFC芯片鉴频，鉴相器(PFD)组成的数字锁相环路(DPL)抑制噪声的原理和有关参数的选择和计算；讨论了由DPLL和微处理机结合组成的数据采集系统，信噪比改善的可能性。
【机 构】
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合肥工业大学
【出 处】
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电子测量技术
【发表日期】
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2001年1期
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