图像混合插值缩放IP核的VLSI设计

来源 :西安电子科技大学学报 | 被引量 : 5次 | 上传用户：hulin510

【摘要】

：

为解决不同的输入视频源在固定分辨率的平板显示器件上无损显示问题,提出一种基于双线性和双三次混合插值的图像缩放算法及其硬件实现方法.基于混合插值算法,完成图像缩放IP核的VLSI设计.该IP核支持多种格式的输入源,无需外部存储器实现高精度的缩放功能,并作为嵌入式IP核在数字视频处理芯片DTV100B中进行功能验证正确.混合插值方法在保持图像细节和清晰度方面优于双线性插值,而在内部存储资源开支上不到双

【作者】

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葛晨阳郑南宁任鹏举

【机构】

：

西安交通大学人工智能与机器人研究所

【出处】

：

西安电子科技大学学报

【发表日期】

：

2010年01期

【关键词】

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图像缩放双线性双三次 IP核超大规模集成电路 image scaling bilinear bicubic IP core VLSI

【基金项目】

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国家高技术研究发展计划（863）资助项目（2009AA01Z307）

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