【摘 要】
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摘要:为了提高FPGA技术映射算法的质量,提出了一种基于布尔可满足性(SAT)的算法,在实现系统功能的前提下,可以将一个子电路映射到数量最少的查看表中。通过将该算法迭代应用于已经完成映射的电路局部,在许多情况下,可以使用更少的查看表来完成。 关键词:布尔可满足性;FPGA;再综合;映射优化;查看表 中图分类号:TP331文献标识码:A 文章编号:1009-3044(2008)35-2502-0
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摘要:为了提高FPGA技术映射算法的质量,提出了一种基于布尔可满足性(SAT)的算法,在实现系统功能的前提下,可以将一个子电路映射到数量最少的查看表中。通过将该算法迭代应用于已经完成映射的电路局部,在许多情况下,可以使用更少的查看表来完成。
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再返回到图3中初始的LUT例子,下面的步骤将给出如何实现这些转换。图5是图3b的细节图,该图清楚地给出了CNF构造的内部连线及配置位。在这些步骤中,f代表需要进行再综合的锥面的函数,Xi代表输入向量x1x2x3=i和fi=f(Xi)。
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