基于FPGA的全数字锁相环设计思路

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【摘要】

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【摘要】通过介绍在FPGA中实现全数字锁相环(DPLL)的原理和方法,提出了一種基于FPGA的锁相环模块化设计,通过分析和仿真验证,可以有效的改善锁定时间和抑制相位抖动。　　【关键词】VHDL；FPGA；全数字锁相环

【作者】

：

黄俊任艳华

【出处】

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科技与企业

【发表日期】

：

2012年14期

【关键词】

：

VHDL FPGA 全数字锁相环

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　　【摘要】通过介绍在FPGA中实现全数字锁相环(DPLL)的原理和方法,提出了一種基于FPGA的锁相环模块化设计,通过分析和仿真验证,可以有效的改善锁定时间和抑制相位抖动。
　　【关键词】VHDL；FPGA；全数字锁相环

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