4 4片上网络芯片的设计及FPGA验证

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片上网络(NoC)被称为是能够从根本上解决复杂片上系统通信瓶颈问题的通信架构。随着VLSI工艺从亚微米、深亚微米到纳米的不断发展,使得NoC芯片设计成为可能。使用VHDL硬件描述语言完成了一款4×4 NoC芯片的设计。芯片功能的FPGA的验证结果表明,该芯片在100 MHz系统时钟情况下工作正常,证明了设计的正确性。同时,基于180 nm HJTC工艺库完成了该款NoC芯片的物理设计。 On-chip networking (NoC) is known as a communications fabric that can fundamentally solve the problem of complex system-on-chip communication bottlenecks. With the VLSI process from sub-micron, deep sub-micron to nano-continuous development, making NoC chip design possible. Using VHDL hardware description language to complete a 4 × 4 NoC chip design. Verification of the chip’s FPGA results show that the chip works well at 100 MHz system clock, proving the correctness of the design. At the same time, the physical design of the NoC chip was completed based on the 180 nm HJTC technology library.
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