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设计了一个100 Mb/s以太网卡芯片时钟产生电路,介绍了电路的体系结构、模块电路分析、锁相环参数设定和芯片版图.该时钟产生电路经过TSMC 0.35μm 1P5M CMOS工艺验证,工作电压为3.3 V.实验结果表明,电路能够满足以太网卡芯片的要求.
100Mb／s以太网卡芯片时钟产生电路的设计与实现
【摘 要】
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设计了一个100 Mb/s以太网卡芯片时钟产生电路,介绍了电路的体系结构、模块电路分析、锁相环参数设定和芯片版图.该时钟产生电路经过TSMC 0.35μm 1P5M CMOS工艺验证,工作电
【机 构】
：
华中科技大学,华中科技大学
【出 处】
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微电子学
【发表日期】
：
2004年1期
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