一种新结构异步FIFO的ASIC设计

来源 :南京师范大学学报(工程技术版) | 被引量 : 0次 | 上传用户：iowreoksbcx

【摘要】

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介绍了一种新结构异步FIFO(First In First Out)电路的实现方案,运用整体移位实现数据正确写入和输出,使用缓冲寄存器组存放移位产生的多余数据,适用于频率不成整数倍的异步

【作者】

：

周磊朱礼安苏俊杰丁晓磊赵梅顾皋蔚朱恩

【机构】

：

东南大学

【出处】

：

南京师范大学学报(工程技术版)

【发表日期】

：

2005年2期

【关键词】

：

异步FIFO ASIC 整体移位缓冲寄存器组 asynchronous FIFO ASIC unitary shift buffers

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介绍了一种新结构异步FIFO(First In First Out)电路的实现方案,运用整体移位实现数据正确写入和输出,使用缓冲寄存器组存放移位产生的多余数据,适用于频率不成整数倍的异步时钟域之间的数据传输.利用串联的D触发器作为同步器,避免产生亚稳态,实现异步信号的同步.采用自顶向下、基于0.18μm标准单元库的半定制ASIC(Application Specific Integrated Circuit)流程对其进行设计:使用Verilog硬件描述语言,利用VCS及Modelsim进行时序和功能仿真、

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