Viterbi译码器的FPGA设计实现与优化

来源 :西安工程科技学院学报 | 被引量 : 0次 | 上传用户：caojun510

【摘要】

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在分析Viterbi译码算法基础上,采用一种新的流水结构设计Viterbi译码器的ACS模块.合理安排幸存路径的读写,采用单指针回溯算法译码输出,最终在Xilinx ISE上完成了约束长度为9

【作者】

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魏忠义覃祥菊

【机构】

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西安工程科技学院电子信息学院

【出处】

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西安工程科技学院学报

【发表日期】

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2005年1期

【关键词】

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VITERBI译码器 FPGA ACS模块 Viterbi decoderFPGAACS module

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在分析Viterbi译码算法基础上,采用一种新的流水结构设计Viterbi译码器的ACS模块.合理安排幸存路径的读写,采用单指针回溯算法译码输出,最终在Xilinx ISE上完成了约束长度为9的Viterbi译码器的FPGA设计.仿真实验结果表明,设计的译码器在资源消耗上有较大优势.

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期刊

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