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本文详述了由一个具有分时处理能力的HDLC处理器对 12 8逻辑通道数据进行高速、并行、实时处理的设计与实现过程 ,并讨论了其实现关键技术 ,给出了系统中关键结点的功能仿真波形图 .
多通道高速HDLC处理器的设计与实现
【摘 要】
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本文详述了由一个具有分时处理能力的HDLC处理器对 12 8逻辑通道数据进行高速、并行、实时处理的设计与实现过程 ,并讨论了其实现关键技术 ,给出了系统中关键结点的功能仿真
【机 构】
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东南大学射频与光电集成电路研究所
【出 处】
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电子学报
【发表日期】
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2003年11期
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