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阐述了电力线通信系统中卷积码及其Viterbi译码的信道编码方法,给出了（2,1,6）卷积码编译码的设计以及采用VerilogHDL硬件描述语言完成卷积码编译码的FPGA实现方法。
电力线通信系统中卷积码和Viterbi译码的FPGA设计实现
【摘 要】
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阐述了电力线通信系统中卷积码及其Viterbi译码的信道编码方法,给出了（2,1,6）卷积码编译码的设计以及采用VerilogHDL硬件描述语言完成卷积码编译码的FPGA实现方法。
【机 构】
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西安电子科技大学电子工程学院
【出 处】
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电子元器件应用
【发表日期】
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2009年7期
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