通用异步串行接口的VHDL实用化设计

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通用异步串行接口(Universal Asvnchronous Receiver Transmitter,UART)在通信、控制等领域得到了广泛应用.根据UART接口特点和应用需求,以提高VHDL设计的稳定性和降低功耗为目标,本文讨论了UART接口中时钟域划分、时钟分频、亚稳态、同步FIFO设计等问题和解决方案.
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