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有记忆信号的观测值是相互关联的，传统检测方法不能达到最佳效果。本文提出一种基于维特比算法的最大似然序列检测器，Viterbi算生将ML序列检测器执行的网格路径搜索的数量减到最小，采用全并行方案，用FPGA作为硬件载体，从而获得更快的速度和更小的电路规模。
基于Viterbi设计最大似然序列检测器
【摘 要】
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有记忆信号的观测值是相互关联的，传统检测方法不能达到最佳效果。本文提出一种基于维特比算法的最大似然序列检测器，Viterbi算生将ML序列检测器执行的网格路径搜索的数量减到
【机 构】
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华东交通大学信息工程学院
【出 处】
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科技广场
【发表日期】
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2006年5期
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