【摘 要】
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为了降低静态随机存储器(SRAM)的动态功耗,提出一种基于位线电荷循环的读写辅助电路的SRAM阵列。与传统设计性比,辅助电路中转和保存了在读写操作中本该被直接泄放掉的位线电荷,并重新用于下一个周期的位线充电。提出的SRAM存储器采用标准14 nm FinFET spice模型搭建,电源供电电压为0.8 V。仿真结果表明,与传统设计相比,提出的存储阵列的功耗可以降低23%~43%,并将SNM和WNM至少提高25%和647.9%。
【机 构】
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北京大学微电子学研究所,北京大学微电子器件与电路重点实验室
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为了降低静态随机存储器(SRAM)的动态功耗,提出一种基于位线电荷循环的读写辅助电路的SRAM阵列。与传统设计性比,辅助电路中转和保存了在读写操作中本该被直接泄放掉的位线电荷,并重新用于下一个周期的位线充电。提出的SRAM存储器采用标准14 nm FinFET spice模型搭建,电源供电电压为0.8 V。仿真结果表明,与传统设计相比,提出的存储阵列的功耗可以降低23%~43%,并将SNM和WNM至少提高25%和647.9%。
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