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本文主要阐述了可配置主机并行接口（HPI）的写缓存与控制模块的逻辑设计，其中详细介绍了写操作控制状态机的状态分析、写缓存管理原则的设计以及写地址的更新处理。
可配置主机并行接口（HPI）写缓存与控制模块的逻辑设计
【摘 要】
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本文主要阐述了可配置主机并行接口（HPI）的写缓存与控制模块的逻辑设计，其中详细介绍了写操作控制状态机的状态分析、写缓存管理原则的设计以及写地址的更新处理。
【机 构】
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武警警官学院
【出 处】
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科教导刊（电子版）
【发表日期】
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2015年18期
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