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该文在原有边沿线平均去隔行算法的基础上设计和实现了改进型的边沿线平均算法。本系统包括rgb2yuv,edge_detection,Sif,yuv2rgb 4个模块,可调参数通过AMBA总线配置。其中Sif模块为本文设计的重点.本设计用VerilogHDL语言实现,同时并为此设计搭建了功能完备的Modelsim仿真环境,进行了仿真验证,最后用FPGA实现其功能。