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由于辐射而在电路的时序逻辑部分和组合逻辑部分产生的逻辑软错误已经逐渐成为阻碍系统可靠性和稳定性的主要威胁。提出了一种结合了基于主／g．1atch设计和改进的时间冗余策略两种技术的容错体系结构，通过ISCAS’89测试基准电路进行验证并对实验结果的分析发现，该容错体系结构获得了很高的容错性能。
一种新型高效容错体系结构的研究与实现
【摘 要】
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由于辐射而在电路的时序逻辑部分和组合逻辑部分产生的逻辑软错误已经逐渐成为阻碍系统可靠性和稳定性的主要威胁。提出了一种结合了基于主／g．1atch设计和改进的时间冗余策略两
【机 构】
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西北工业大学计算机学院
【出 处】
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航空计算技术
【发表日期】
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2009年6期
【基金项目】
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国家自然科学基金资助项目（60736012,60573107）
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