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本文设计了一种高速、低失真的开关电容采样保持电路,它采用了bootstrapped开关来降低非线性,并提出了减小放大器的建立时间的方法.结果表明其在40M的采样速度下,可以得到大于70dB的线性.
一种高速、低失真的采样保持电路
【摘 要】
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本文设计了一种高速、低失真的开关电容采样保持电路,它采用了bootstrapped开关来降低非线性,并提出了减小放大器的建立时间的方法.结果表明其在40M的采样速度下,可以得到大
【机 构】
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东南大学国家专用集成电路系统工程技术研究中心
【出 处】
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电路与系统学报
【发表日期】
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2004年4期
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