时序电路多故障串并行模拟

来源 :内蒙古大学学报(自然科学版) | 被引量 : 0次 | 上传用户:wh820228
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本文给出一个时序逻辑电路的多故障测试模拟程序。为节省内存空间,采用了串并行模拟方式。同时还介绍了一种元件模拟顺序的快速生成复法 This paper presents a sequential logic circuit fault simulation test program. To save memory space, the use of a series of parallel simulation. At the same time, a rapid generation method of component simulation sequence is also introduced
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