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期刊论文
嵌入式微处理器的高层总线缓冲模型
嵌入式微处理器的高层总线缓冲模型
来源 :电路与系统学报 | 被引量 : 0次 | 上传用户:xxuhhe
【摘 要】
:
本文针对嵌入式微处理器结构特征,提出了一种高层总线缓冲模型。随后根据提出的缓冲模型设计仿真算法,并根据实际的设备行为进行抽样统计分析,实现了带有缓冲设备的高层动态仿真
【作 者】
:
吴旭凡
凌明
杨军
【机 构】
:
东南大学国家专用集成电路系统工程技术研究中心
【出 处】
:
电路与系统学报
【发表日期】
:
2006年5期
【关键词】
:
高层模型
嵌入式微处理器
缓冲
总线带宽
high-level model
embedded microprocessor
buffer
bus band
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本文针对嵌入式微处理器结构特征,提出了一种高层总线缓冲模型。随后根据提出的缓冲模型设计仿真算法,并根据实际的设备行为进行抽样统计分析,实现了带有缓冲设备的高层动态仿真。结果显示高层的仿真结果反映了实测电路级仿真的数据趋势,具有很好的一致性,证明了高层模型及仿真的有效性。
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