【摘 要】
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测试模式生成对集成电路内建自测试（built-in self-test,BIST）的效率具有重要影响.现有的并行折叠计数器（parallel folding counter,PFC）只能实现状态向量（state vector,SV）的顺序
【机 构】
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合肥工业大学电子科学与应用物理学院,合肥工业大学计算机与信息学院
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测试模式生成对集成电路内建自测试（built-in self-test,BIST）的效率具有重要影响.现有的并行折叠计数器（parallel folding counter,PFC）只能实现状态向量（state vector,SV）的顺序折叠计算,导致大量冗余模式产生而限制了其在BIST中的应用.提出一种支持状态向量选择生成的并行折叠计数器,采用固定的初始翻转控制向量（flip control vector,FCV）,建立折叠距离与翻转控制向量的内在逻辑关系.通过位替换控制逻辑对折叠距离（folding
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