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HDR视频算法优化及硬件实现

来源 :计算机研究与发展 | 被引量 : 6次 | 上传用户：tq19822002

【摘 要】

：

高动态范围(high dynamic range,HDR)视频算法计算复杂度高,硬件实现需要大量逻辑和存储资源,且现有的算法难以满足高分辨率下的实时性要求.针对上述问题,提出一种优化的HDR视频流水线算法,同时利用FPGA的并行可重构特性,完成该算法的硬件实现.算法首先将相机响应函数内置于FPGA的查找表(look-up table,LUT)中,对3帧低动态范围(low dynamic range

【作 者】

：

吴安 金西 杜学亮 张克宁 姚春赫 马淑芬 

【机 构】

：

中国科学院强耦合量子材料物理重点实验室（中国科学技术大学物理学院）,国家专用集成电路设计工程技术研究中心合肥分中心

【出 处】

：

计算机研究与发展

【发表日期】

：

2017年05期

【关键词】

：

现场可编程门阵列 高动态范围视频 色调映射 相机响应函数查找表 辉度图 

【基金项目】

：

中国科学院战略性先导科技专项课题（XDA06010402-4）

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高动态范围(high dynamic range,HDR)视频算法计算复杂度高,硬件实现需要大量逻辑和存储资源,且现有的算法难以满足高分辨率下的实时性要求.针对上述问题,提出一种优化的HDR视频流水线算法,同时利用FPGA的并行可重构特性,完成该算法的硬件实现.算法首先将相机响应函数内置于FPGA的查找表(look-up table,LUT)中,对3帧低动态范围(low dynamic range,LDR)图像进行合并,转换后的数据通过多路并行流水缓存在FPGA的BRAM中;然后使用快速的全局色调映

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