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在介绍LDPC（Low Density Parity Code）低密度校验码的基本迭代译码原理的基础上,针对FPGA技术,专门设计了译码器中通用的变量节点以及校验节点处理单元,其中分别包括全并行与全串行的实现方式。编译结果表明,这些模块可以实现高速的处理速度,以及占用合理的硬件资源。
LDPC码译码器通用模块的FPGA设计
【摘 要】
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在介绍LDPC（Low Density Parity Code）低密度校验码的基本迭代译码原理的基础上,针对FPGA技术,专门设计了译码器中通用的变量节点以及校验节点处理单元,其中分别包括全并行与全
【机 构】
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中国电子科技集团公司第五十四研究所
【出 处】
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电子技术与软件工程
【发表日期】
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2016年14期
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