【摘 要】
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为了解决传统中值滤波算法不能满足图像预处理系统实时性要求的问题,提出了一种基于比较编码的图像中值滤波快速算法,并运用Verilog HDL硬件描述语言在Xilinx公司的FPGA上进
【基金项目】
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西北工业大学研究生创业种子基金资助(Z2012116)
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为了解决传统中值滤波算法不能满足图像预处理系统实时性要求的问题,提出了一种基于比较编码的图像中值滤波快速算法,并运用Verilog HDL硬件描述语言在Xilinx公司的FPGA上进行了设计实现和功能仿真实验.实验结果表明该算法完成图像3×3窗口的中值查找运算需要6个时钟周期,16次数值比较,远高于其他算法的处理效率,非常适合应用于对实时性要求严苛的图像预处理系统.
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