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用基本逻辑门电路、多路数据选择器、译码器实现全加器的设计方法
利用中规模集成电路进行逻辑设计
【摘 要】
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用基本逻辑门电路、多路数据选择器、译码器实现全加器的设计方法
【机 构】
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辽宁工程技术大学职业技术学院
【出 处】
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锦州师范学院学报(自然科学版)
【发表日期】
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2002年1期
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