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为了降低图像缩放IP的硬件资源占用率并获得最佳的图像缩放质量,采用基于二次函数的三点控制插值算法并利用FPGA实现。阐述该IP的系统架构,重点介绍线性缓存的读写控制和插值算法的优化处理,相比双三次图像插值算法,该IP的FPGA硬件资源占用仅有其一半。
图像缩放IP的FPGA实现
【摘 要】
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为了降低图像缩放IP的硬件资源占用率并获得最佳的图像缩放质量,采用基于二次函数的三点控制插值算法并利用FPGA实现。阐述该IP的系统架构,重点介绍线性缓存的读写控制和插值算法的优化处理,相比双三次图像插值算法,该IP的FPGA硬件资源占用仅有其一半。
【机 构】
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四川教育学院网络与信息管理中心
【出 处】
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四川教育学院学报
【发表日期】
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2011年11期
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