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针对YHFT-DSP外部同步存储器接口的时序问题，本文综合考虑工程实际、设计开销和实现自动化等因素，给出了封装延时差、单元延时和IO单元虚延时三种优化方法．芯片测试结果表明：基于时钟提前的10单元虚延时方法能够高效地实现133MHz时钟频率的外部同步存储器接口访问。
YHFT-DSP外部同步存储器接口时序设计优化
【摘 要】
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针对YHFT-DSP外部同步存储器接口的时序问题，本文综合考虑工程实际、设计开销和实现自动化等因素，给出了封装延时差、单元延时和IO单元虚延时三种优化方法．芯片测试结果表明：基于
【机 构】
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国防科学技术大学计算机学院,长沙大学计算机科学与技术系
【出 处】
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湖南大学学报：自然科学版
【发表日期】
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2009年8期
【基金项目】
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国家自然科学基金资助项目（60873212,60876024）.
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