【摘 要】
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在实际应用中,捷变频雷达的信号处理机给频率综合器送去不同的频率码,使雷达发射机和接收机工作在相应的不同频点上,躲避无源和有源干扰。本文基于对捷变频雷达抗干扰基本原
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在实际应用中,捷变频雷达的信号处理机给频率综合器送去不同的频率码,使雷达发射机和接收机工作在相应的不同频点上,躲避无源和有源干扰。本文基于对捷变频雷达抗干扰基本原理的阐述,并结合ANALOGDEVICES公司的TigerSHARC20XS系列DSP芯片以及ALTERA公司的CycloneEP1C6XXX系列FPGA芯片,提出了伪随机捷变频和自适应捷变频的工程设计方法。最后通过功能仿真,说明了此种方法成功解决了传统方法中伪随机捷变频只能产生2n（1≤n≤32）长度频率码序列的问题,同时也验证了自适应捷变频设
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