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针对直接数字频率合成(DDS)和集成锁相环(PLL)技术的特性,提出了一种新的DDS激励PLL系统频率合成时钟发生器方案.分析了频率合成系统相位噪声和杂散抑制的方法,介绍了主要器件AD9854和ADF4106的性能.
基于DDS＋PLL技术的高频时钟发生器
【摘 要】
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针对直接数字频率合成(DDS)和集成锁相环(PLL)技术的特性,提出了一种新的DDS激励PLL系统频率合成时钟发生器方案.分析了频率合成系统相位噪声和杂散抑制的方法,介绍了主要器
【机 构】
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国防科技大学电子科学与工程学院,国防科技大学电子科学与工程学院
【出 处】
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现代电子技术
【发表日期】
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2004年14期
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