【摘 要】
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本文结合实际研发要求,对基于USB2.0的数字音频编解码片上系统的可测试性设计(DFT)策略进行了研究。该系统采用UMC 0.13μm CMOS工艺,集成SPRAM、DPRAM、ROM、上电复位单元POR(P
【机 构】
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西安交通大学电子与信息工程学院1723信箱,西安交通大学理学院,西安交通大学VLSI设计研究中心
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本文结合实际研发要求,对基于USB2.0的数字音频编解码片上系统的可测试性设计(DFT)策略进行了研究。该系统采用UMC 0.13μm CMOS工艺,集成SPRAM、DPRAM、ROM、上电复位单元POR(Power On Reset)、降压转换器LDO(Low Drop Out regulator)、锁相环PLL(Phase Locked Loop)、电熔丝盒(e-fuse box)、ADC、USB焊盘等模块。本文采用JTAG(Joint Test Action Group)和焊盘控制逻辑PCL(Pad
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