【摘 要】
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高密度PCB（printed circuit board）设计中，高速时钟信号的信号完整性设计面临越来越大的挑战。针对该问题，文章研究了传输线的特性阻抗及其对信号传输延时的影响，利用Cadence的信
【机 构】
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华中科技大学机械科学与工程学院,广州深圳市浩能科技有限公司
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高密度PCB（printed circuit board）设计中，高速时钟信号的信号完整性设计面临越来越大的挑战。针对该问题，文章研究了传输线的特性阻抗及其对信号传输延时的影响，利用Cadence的信号完整性分析软件AllegroPCBSI，对一款基于ARM的嵌入式运动控制平台的时钟信号存在的信号完整性（signalintegrity，SI）问题进行了再现仿真，重点分析了信号反射与串扰现象及其产生原因，提出了减小时钟信号串扰和反射的措施；结合阻抗匹配原则，以嵌入式运动控制平台的SDRAM和USB时钟信号为
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