【摘 要】
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介绍了为PET(正电子发射断层扫描仪 )的前端电子学模块提供时间基准而设计的一种新型高频时钟扇出电路。该电路利用FPGA芯片来实现对高频时钟的分频与分配 ,并用LVDS传输标准
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介绍了为PET(正电子发射断层扫描仪 )的前端电子学模块提供时间基准而设计的一种新型高频时钟扇出电路。该电路利用FPGA芯片来实现对高频时钟的分频与分配 ,并用LVDS传输标准对生成的多路时钟信号进行传输 ,从而最大程度地减少了输出各路时钟之间的延时偏差 ,同时利用低压差分信号的传输特性增强了信号的抗干扰能力。文章给出了采用VHDL语言编写的时钟电路程序代码
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